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応用情報技術者 2015年 秋期 午前2 問23


問題文

ワンチップマイコンにおける内部クロック発生器のブロック図を示す。15MHzの発振器と、内部のPLL1, PLL2及び分周器の組合せでCPUに240MHz, シリアル通信 (SIO) 115kHzのクロック信号を供給する場合の分周器の値は幾らか。ここで、シリアル通信のクロック精度は±5%以内に収まればよいものとする。
応用情報技術者 2015年 秋期 午前2 問23の問題画像

選択肢

ア:
イ:
ウ:
エ:(正解)

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分周比の算出【午前2解説】

正解の理由

図から分かる通り、15 MHzの発振器はまず内部のPLL1で8倍されて を生成しています。分周器はPLL1出力(120 MHz)に接続されており、ここからシリアル通信(SIO)に115 kHz(許容誤差 ±5%)を供給する必要があります。必要な分周比は で、選択肢は のみなので最も近い を用います。これにより出力は となり、誤差は約 で ±5% 範囲内です。したがって エ が正解です。

解法ステップ

  1. 図から分周器の入力がPLL1の出力であることを確認する(PLL1は15 MHzを8倍して120 MHzを出力)。
  2. 目標周波数115 kHzに対する必要な分周比を計算する: 。
  3. 選択肢が の形なので、1043.478に最も近い を求める → 。
  4. 得られる出力周波数を計算して精度条件を検証: 、誤差約1.90%(±5% 内)。

選択肢別の誤答解説

  • ア:
    出力は (7500 kHz)で、115 kHzから大きく外れる。
  • イ:
    出力は (1875 kHz)で、目標とは無関係に大きすぎる。
  • ウ:
    出力は 、これも115 kHzから大きく外れる。
  • エ: (正解)
    出力117.1875 kHz、許容誤差 ±5%(下限109.25 kHz、上限120.75 kHz)に収まる。
(注)もし分周器の入力を誤ってPLL2(240 MHz)と見なすと別の分周比が必要になりますが、図の配線は分岐がPLL1から分周器へ向かっているため、その誤解は誤りです。

よくある誤解

  • PLL2(240 MHz)から分周して考えてしまう誤り:図の分岐を正しく読み、分周器がPLL1出力(120 MHz)に接続されていることを確認する必要があります。
  • 周波数の単位を混同する:Hz・kHz・MHzを混ぜて計算ミスする例が多いです。式の前に必ず単位を揃えましょう。
  • 許容誤差を「ちょうど一致」で判断する:問の仕様に「±5%以内」とある場合はギリギリでなく範囲内かどうかで判断します。完全一致は不要です。

補足コラム

  • 許容範囲の具体値:115 kHzの ±5% は下限 、上限 。今回の117.1875 kHzはこの範囲内です。
  • 実装上の注意:分周器が整数比(今回のように2のべき)しか取れない場合、最も近い値を選んで誤差を評価します。より厳密な周波数が欲しければ、PLLの分周/乗算組合せを再設計するか、分数ナイキスト分周器や外部クロックを用いることがあります。

FAQ

Q1: なぜPLL1出力を使うと分かりますか?
A1: 問題の図において分岐線がPLL1から下向きに伸びて分周器に接続されているためです。配線位置を必ず確認してください。
Q2: もし分周器が任意の整数比を取れるなら理想比は何ですか?
A2: 理想(無制約)なら 、整数なら1043または1044が近いですが、設問の選択肢は 型に限られているため を選びます。
Q3: 四捨五入の扱いは?
A3: 最も近い選択肢を選び、出力周波数が規定の許容範囲に入るかを確認します。単に四捨五入するだけでなく誤差率を計算して判断してください。

関連キーワード: PLL、分周器、クロックジェネレータ、周波数算出、クロック精度、周波数分配、ビット素子(2のべき)
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